从寄存器配置入手理解i2c读写eeprom代码-智慧文博士

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✅ 摒弃模板化标题（如“引言”“总结”），代之以逻辑连贯、层层递进的叙事流；
✅ 所有技术点均融合在真实开发语境中展开，不堆砌术语，重在“为什么这么干”；
✅ 关键寄存器操作、时序陷阱、页写边界、ACK误判等痛点全部用工程师口吻讲透；
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✅ 字数扩展至约2800字，信息密度高、无冗余。

当你的I²C写不进EEPROM时，该翻哪一页寄存器？

你有没有遇到过这样的时刻：
HAL库函数调得顺滑无比，HAL_I2C_Master_Transmit()返回HAL_OK，但一读回来全是0xFF？
示波器上SCL/SDA波形看起来“挺规矩”，可EEPROM就是不认地址——明明接线没错、上拉电阻也焊上了，OAR1设成0x50，却死活进不了ADDR中断？
又或者，连续写入16个字节后，第9个数据诡异地出现在地址0x00而不是0x08？

这些问题，HAL库不会告诉你答案。它只负责“把数据塞进总线”，而真正决定数据能不能落进EEPROM存储单元的，是那几组你可能从未细看过、甚至不敢轻易改写的寄存器：CCR、TRISE、OAR1、SR1、SR2……以及，EEPROM芯片手册里夹在几十页电气特性中间、被你跳过的那一行小字：“Page Write is limited to 8 bytes per page.”

今天，我们就从一个失败的写操作开始，把I²C读写EEPROM这件事，拆到寄存器比特位的粒度，看看那些“理所当然”的行为背后，究竟藏着多少硬件与协议的默契和妥协。

你以为的“发地址”，其实是三件事在同时发生

很多初学者以为，向EEPROM写一个字节，就是“发设备地址 → 发内存地址 → 发数据”。
但真相是：当你往I2C1->DR写入0xA0（即0x50 << 1 | 0）那一刻，硬件状态机已经启动了三重校验：

物理层握手：检查SCL是否空闲（SB标志置位）、SDA是否释放；
地址匹配仲裁：比对OAR1[7:1]与收到的前7位是否一致；
协议状态跃迁：一旦匹配成功，自动拉低SDA产生ACK，并将SR1的ADDR位置1——但这个标志不会自己清零！

这就是为什么这段代码里必须有(void)I2C1->SR2;：

I2C1->DR = 0xA0; while (!(I2C1->SR1 & I2C_SR1_ADDR)); // 卡在这儿？因为你没清ADDR！ (void)I2C1->SR2; // ← 这一行不是可有可无，是协议强制要求！

SR2是状态寄存器2，它的存在意义，就是让你“读一次就清一次ADDR”。如果不读，ADDR一直为1，后续任何DR写入都会被硬件忽略——你的数据根本发不出去。这不是bug，是设计。就像老式机械门锁，钥匙插进去转到位（ADDR=1），但你得再推一下门框（读SR2）才能真正打开。

CCR不是算出来就完事的，TRISE才是那个“背锅侠”

我们常按公式算CCR：

CCR = (PCLK / (2 × I2C_CLK)) – 1

PCLK=36MHz，目标速率100kHz →CCR = 179，看起来很完美。
但如果你实际测出SCL高电平时间只有1.2μs（远小于标准要求的4.0μs），问题大概率出在TRISE。

TRISE不是“上升时间设定值”，而是上升沿计数器的上限阈值。它告诉硬件：“如果SCL从低到高花了超过TRISE个APB1周期，就报错”。
而它的推荐值是：TRISE = (tR × fPCLK) + 1，其中tR是总线上升时间（由上拉电阻+线路电容决定）。

你焊了个4.7kΩ上拉，但PCB走线绕了三圈、旁边还贴着USB差分线——实测tR可能是800ns，不是手册假设的300ns。这时若仍填TRISE = 37，硬件会在每次上升沿还没走完时就判定“超时”，触发BERR，然后默默拉低SCL“自我保护”。

所以，CCR决定速率，TRISE决定容忍度。二者必须协同调试。更务实的做法是：先用逻辑分析仪抓波形，量出真实tR，再反推TRISE；或直接在TRISE上留余量（比如+3~5），让硬件多等一会儿。

EEPROM的“地址”有两个世界：设备地址是硬件引脚定的，内存地址是软件要掰开的

AT24C02的设备地址格式是1010 A2 A1 A0，其中A2/A1/A0由芯片引脚电平决定。这意味着：
- 如果你把A0悬空（NC），它可能默认上拉或下拉——不同厂商行为不一致；
- 如果你用同一块PCB焊了两颗AT24C02，而A0都接地，那它们地址都是0x50，I²C总线上就会出现两个“同名者”，通信必然紊乱。

这解释了为什么冷启动后参数变回出厂值：
不是代码错了，是EEPROM根本没响应。AF标志被置位，但你的错误处理只打印了一句“ACK fail”，没查OAR1[15]是否误设为10-bit模式（此时OAR1 = 0x8000 | 0x50会被解释为10-bit addr = 0x050，而非7-bit = 0x50）。

而内存地址更隐蔽：256字节容量用1字节寻址（0x00–0xFF），但512Kbit型号要用2字节（0x0000–0xFFFF）。如果你的驱动硬编码addr_bytes[0] = mem_addr & 0xFF，面对大容量EEPROM，高位地址永远丢失——数据全写进第0页。

所以，真正的健壮驱动，必须在初始化时通过WHO_AM_I类指令（如有）或容量探测，动态确定内存地址宽度，而不是靠#define硬写死。

页面写入不是“功能”，是EEPROM的生存本能

AT24C02一页8字节，这个数字不是工程师拍脑袋定的，是内部电荷泵电路能同时擦写的物理极限。
当你向0x07地址发起10字节页写，硬件会这样执行：
-0x07,0x08,0x09,0x0A,0x0B,0x0C,0x0D,0x0E→ 填满第0页（0x00–0x07）；
- 第9字节0x0F→ 自动跳回0x00，覆盖首字节；
- 第10字节0x10→ 覆盖0x01……

这就是“页面回卷”。HAL库的HAL_I2C_Mem_Write()内部做了截断，但裸机代码若不做检查，数据错位就是必然。

更关键的是：写周期内EEPROM对外表现为“NACK一切”。它不是拒绝，是“正在忙”。如果你在HAL_Delay(5)前就发下一次起始信号，它可能直接无视——因为内部状态机还在擦除，没空管总线。

所以，工程上更可靠的等待方式不是HAL_Delay，而是轮询“它什么时候愿意说话”：

// 写入后，持续发 [DevAddr+W] 直到得到ACK uint8_t poll_ack(uint8_t dev_addr) { for (int i = 0; i < 100; i++) { // 100ms超时 I2C1->CR1 |= I2C_CR1_START; while (!(I2C1->SR1 & I2C_SR1_SB)); I2C1->DR = (dev_addr << 1) | 0; HAL_Delay(1); if (!(I2C1->SR1 & I2C_SR1_AF)) return 0; // 收到ACK I2C1->CR1 |= I2C_CR1_STOP; HAL_Delay(1); } return 1; // timeout }

这比HAL_Delay(6)更鲁棒，尤其在电压波动、温度变化导致tWR延长时。

最后一句实在话

寄存器级编程的价值，从来不是为了“炫技”或“替代HAL库”，而是当你面对一块新EEPROM、一份不完整的数据手册、一段跑在客户现场十年的老设备固件时，能快速判断：
是TRISE设小了导致上升沿被误判？
是OAR1配置错位让地址匹配永远失败？
还是页写逻辑漏掉了跨页分支，让关键配置悄悄覆盖了启动标志？

这些能力，不会出现在简历的“熟悉HAL库”里，但会真实出现在每一次量产前的深夜调试中，出现在FAE电话里那句“你们确认过EEPROM的A0引脚电平吗？”之后的沉默里。

如果你正卡在某个I²C问题上，欢迎把现象、波形截图、寄存器配置片段发出来——我们可以一起，翻一翻那本被放在书架最底层、边角卷起的数据手册。